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    电路端接的图

    2016-9-27 18:50:43 点击:
      头接,是咱们在电路中经常用到的。在快速电路中,头接显得尤其重要。如果在电路设计的时光没有进行科学的嘴接,严重的可能性造成电路完全不能工作。同一天就来说说端接这点事。  

    先说说电路为什么需要端接?显然,电路中如果阻抗不继续,就会造成信号的辐射,引起上冲下冲,振铃等信号失真,严重影响信号质量。因而在开展电路设计 的时光阻抗匹配是很要紧的设想因素。咱的PCB走线进行阻抗控制已经不是什么高深的技巧了,基本上是每个硬件工程师必备之主导能力。这就是说在实际电路中, 只考虑走线的对抗还缺少。切切实实电路都是由发送端,连线,和接受端共同组成的。咱愿意做到的是所有链路的对抗都是一致的。但是实际电路中很难做到这一点, 普通发送端的转口阻抗会比较小,而接收端的涌入阻抗又很高,这就是说要处理好这对矛盾,头接就变成一种很大方之手法。故而,头接的本色依然是对抗匹配,以此是 拓展PCB规划的主要。    

    广大的嘴接方式有下面几种:串联端接,并联端接,戴维宁颖接以及RC网络端接。下就简单介绍一下几种端接方式的分别和优缺点。    

    (1) 串联端接。这是咱们最容易想到也最常用的一种端接方式。发送端的转口阻抗比较小,这就是说我们在电路上直接串联一个电阻,有效输出阻抗加上电阻阻值的总阻抗等 于传输线阻抗,这样就能保证阻抗的连续性,调减信号的辐射。串联端接实现比较简便,缺点也比较显著,鉴于线路中串联了雷达,会影响信号的上升时间,在快速 电路中可能会引起问题。此外由于电阻的分压,有效发送端输出减小。串联端接的雷达要放在尽量靠近发送端的岗位,能发挥更好的图。    

    (2) 并联端接。顶接收端的涌入阻抗比较大时,咱可以考虑在接到端并联端接一个电阻到地或者到电源。雷达的阻值等于走线的特点阻抗。穿越这种办法实现阻抗匹 配。这种办法和串联端机一样简单易行,缺点是会消耗直流功率。上拉的时光能增强驱动能力,从拉的时光能增强对电流的收取能力。    

    (3) 戴维宁颖接。戴维宁颖接就是采取上拉电阻和从拉电阻来共同组成端接电路,有效戴维宁等效阻抗等于传输线的特点阻抗以促成阻抗匹配。戴维宁颖接的亮点是上拉 雷达和从拉电阻都能用来接受反射,在电路上没有信号的时光,还能够为电路提供一个直流电平,适当总线应用。但是缺点也很显然,那就是出于电阻的生存,在电 源盒地之间存在直流通路,直流功耗较大。    

    (4) RC网络端接。RC网络端接是并联端接的升级版。就是在并联到地的雷达下面再增长一颗电容。这样既能够和并联端接一样减小反射,同时由于电容的生存隔离了 直流,调减了直流功耗。当然缺点也很显然,RC电路的时空常数会影响信号的上升时间,在快速电路使用中要密切计算。    

    在具体的邮路中,咱要依据电路的不同特点选择适宜的嘴接方式。比如在DDR芯片的数据线和地点线上我们都会利用端接电阻。但是两者之岗位是略有区别的。 鉴于地址线是一派的,都是下主控端到存储端,因而我们用串联端接的时光把串联电阻靠近主控端效果会比较好。但是由于数据线上的信号是走向的,串联电阻靠近 何一端都很难同时满足发送与接收的要求,此时只能折中考虑放在线路的中等。而在更高速的DDR2或者DDR3芯片中,鉴于采取了ODT(片上端接)艺术, 头接电阻直接做在了蕴藏芯片内部,这就是说外部就不需要做端接处理了。此外如果发送端和接受端的距离很近,走线可以操纵的很短,走线上信号的延时不足信号上升 岁月之二十分之一,这就是说不加端接电阻一般也能健康工作。可以见到来,PCB规划没有哪种方法是万能的,因而需要我们去领略电路真正的图,形成知其然知其 所以然。切实问题具体分析,灵活的采取各种设计规则和艺术,更好的形成项目。

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